ความแตกต่างระหว่าง PLL และ DLL คืออะไร?


25

Phase Locked Loops (PLL's) และ Delay Locked Loops (DLL) ถูกใช้ในแอพพลิเคชั่นต่าง ๆ แต่ยังไม่มีการพูดคุยถึงประเด็นสำคัญของวงจรเหล่านี้ว่าพวกเขาทำงานอย่างไรในแอพพลิเคชั่นที่พวกเขาอาจจะใช้ ทั้งสองวงจรและทำไมจึงควรใช้กับอีกวงจรหนึ่ง

คำตอบ:


14

PLL ควบคุมออสซิลเลเตอร์ที่ควบคุมแรงดันไฟฟ้าเพื่อนำความถี่ (หรืออนุพันธ์ของมัน) เข้าสู่เฟสล็อค (และความถี่) ด้วยสัญญาณอ้างอิง

PLLs มีแอพพลิเคชั่นมากมายตั้งแต่การสร้างแบบจำลองที่ "สะอาด" ของสัญญาณอ้างอิงที่มีเสียงดัง (เมื่อมีการเปลี่ยนแปลงแอมพลิจูดและเฟส) จนถึงการสร้างความถี่ใหม่ผ่านการทวีคูณและการหาร คุณสมบัติการถ่ายโอนอินพุต - เอาท์พุตของ PLL สามารถควบคุมผ่านการออกแบบเครือข่ายป้อนกลับ

DLL ควบคุมเส้นหน่วงเวลาที่ควบคุมด้วยแรงดันไฟฟ้าซึ่งโดยทั่วไปจะมีก๊อกจำนวนมากเพื่อที่จะนำหนึ่งในเส้นทางนั้นเข้าสู่การจัดตำแหน่งเฟสด้วยสัญญาณอ้างอิง อินพุตไปยังสายหน่วงเวลามักเป็นสัญญาณอ้างอิงด้วยเช่นกันดังนั้นดอกต๊าปต่างๆจึงให้สัญญาณเพิ่มเติมที่ถูกสอดแทรกและ / หรือประมาณค่าจากช่วงเวลาของสัญญาณอ้างอิง

DLLs มักใช้ในการสื่อสารความเร็วสูงระหว่างชิปบนบอร์ด (เช่นระหว่างตัวควบคุมหน่วยความจำและชิป SDRAM) เพื่อ "ยกเลิก" สิ่งต่าง ๆ เช่นความล่าช้าบัฟเฟอร์อินพุตและเอาต์พุตรวมถึงความล่าช้าในการเดินสายทำให้ควบคุมได้แน่นมาก การตั้งค่าและเวลาค้างไว้สัมพันธ์กับสัญญาณนาฬิกา สิ่งนี้ทำให้อัตราการส่งข้อมูลสูงกว่าที่เป็นไปได้

ด้วยเครื่องตรวจจับเฟสที่ได้รับการออกแบบมาอย่างเหมาะสมทั้ง PLL และ DLL สามารถทำงานกับสัญญาณอ้างอิงที่ไม่สามารถย่อยสลายได้ แอปพลิเคชันทั่วไปเกี่ยวข้องกับการจัดตำแหน่งการเปลี่ยนสัญญาณข้อมูลด้วยนาฬิกาอ้างอิง

ในขณะที่ดังกล่าวข้างต้น (เช่นรุ่นที่สะอาดของสัญญาณ -> PLL) ลักษณะสำคัญของการที่ PLLs / DLLs แตกต่างกันคือตัวกรองของ PLL และป้องกันการกระวนกระวายใจอย่างมีประสิทธิภาพในแหล่งที่มาจากผลกระทบต่อเอาท์พุท VCO ในขณะที่ DLL เผยแพร่เผยแพร่ ในตอนแรกสิ่งนี้อาจดูเหมือนเป็นด้านลบของ DLL แต่สามารถใช้เพื่อผลที่ดี ในบางกรณีคุณจำเป็นต้องดึงจุดสุ่มตัวอย่างหลักจากสัญญาณที่มาถึงและไม่สนใจสัญญาณที่กระวนกระวายใจในสัญญาณคุณจะต้องใช้ PLL ในกรณีอื่น ๆ พูดเมื่อสัญญาณและสัญญาณนาฬิกาอยู่ภายใต้การกระวนกระวายใจเดียวกันทำให้เกิดผลกระทบที่แหล่งที่มาหรือในช่องทางการสื่อสาร


คุณได้เริ่มต้นที่ดีที่นี่ แต่มีประเด็นสำคัญสองสามข้อที่ต้องครอบคลุมซึ่งมีผลโดยตรงต่อสถานการณ์ที่ใช้วงจรเหล่านี้ การแพร่กระจายคำแนะนำ - กระวนกระวายใจ
ตัวยึด

สามารถใช้ DLL กับสัญญาณที่ไม่เป็นงวดได้หรือไม่? ถ้าเป็นเช่นนั้นดูเหมือนว่าจะเป็นจุดสำคัญที่ควรค่าแก่การกล่าวขวัญ
supercat

2
บางทีฉันควรชี้แจงคำถามของฉัน: วัตถุประสงค์ของ PLL คือการใช้สัญญาณ X และสร้างสัญญาณเป็นระยะซึ่งมีขอบทุกที่ที่มีขอบอยู่ใน X และน่าจะมีขอบอื่น ๆ อีกมากมาย ฉันเดาว่า DLL จะรับสัญญาณ X และการอ้างอิง Y และพยายามหน่วงเวลา X ด้วยจำนวนตัวแปรที่ขอบใน X ที่ควรเกิดขึ้นในเวลาเดียวกับที่ขอบใน Y ทำ แต่ขอบที่ไม่มีอยู่ ใน X ไม่ควรมีอยู่ในเอาต์พุตของ DLL หรือจะดูอีกทางหนึ่ง ...
SuperCat

... ฉันเดาว่าในขณะที่จุดประสงค์ของ PLL คือการผลิตนาฬิกาที่สอดคล้องกับการอ้างอิง (นั่นอาจจะเป็นระยะหรือเป็นช่วง ๆ ) จุดประสงค์ของ DLL ก็เพื่อให้สอดคล้องกับสัญญาณที่ไม่เป็นระยะดังนั้นเวลาของมันจึงสอดคล้องกับ การอ้างอิง สิ่งนี้อาจจำเป็นถ้ามีสัญญาณที่ไม่เป็นระยะ ๆ จำนวนมากซึ่งบิดเบือนโดยจำนวนตัวแปรอิสระและต้องการป้อนเข้าวงจรที่ใช้นาฬิการ่วมกัน ดูเหมือนว่าจะเป็นคำอธิบายที่ยุติธรรมหรือไม่?
supercat

@supercat: ยุติธรรมเพียงพอ แต่นั่นไม่ใช่การใช้งานอย่างเดียวของพวกเขา ที่กำลังจะใช้ในการจัดตำแหน่งสัญญาณ (นาฬิกา) เป็นระยะเช่นกัน
Dave Tweed

2

พวกเขาแตกต่างกันในโครงสร้างของพวกเขา PLL ใช้ Oscillator แรงดันไฟฟ้าควบคุม (VCO) ซึ่ง DLL ไม่ใช้

DLLs นั้นใหม่กว่า PLL และใช้งานมากขึ้นในแอปพลิเคชันดิจิตอล ที่กำลังใช้เฟสแปรผันเพื่อให้เกิดการล็อคนั่นคือพวกมันล็อคบนความแตกต่างของเฟสคงที่ในขณะที่ PLL ใช้บล็อกความถี่แปรผันนั่นคือพวกเขาปรับความถี่จนกว่าพวกเขาจะมีการล็อค

สำหรับแอปพลิเคชั่นบันทึกดิจิตอลส่วนใหญ่คุณสามารถใช้แอพพลิเคชั่นสลับกันได้


ในขณะที่ส่วนประกอบย่อยบางตัวของ DLL และ PLL เหมือนกัน VCO ใน PLL จะถูกใช้เพื่อบรรลุความหลากหลายของเฟสและความถี่ ไม่สามารถพูดถึงบล็อกการหน่วงเวลาตัวแปรใน DLL ได้ มีวงจรไม่กี่ตัวที่สามารถใช้แทนกันได้ (ในตัวอย่างของการปรับเปลี่ยนรูปแบบดิจิทัล) แต่ส่วนใหญ่คุณสมบัติที่เป็นเอกลักษณ์ของพวกมันจะป้องกันไม่ให้มีการสลับกัน
ตัวยึดตำแหน่ง

0

ความแตกต่างที่สำคัญระหว่าง PLL และ DLL คือ:

1) PLL แยก (ล็อค) ทั้งความถี่และเฟสของสัญญาณอินพุต DLL แยกเฟสเท่านั้น

2) DLL ต้องการนาฬิกาอ้างอิง PLL ไม่จำเป็นต้องใช้นาฬิกาอ้างอิง แต่มันสร้างขึ้นมาแทน

3) PLL ใช้ VCO DLL ไม่มี VCO

ดังนั้นในแง่หนึ่งเราสามารถพูดได้ว่า PLL นั้นแข็งแกร่งกว่า DLL เพราะมันสามารถดึงความถี่ของข้อมูลได้ไม่เพียงแค่เฟส สมมติว่ามีนาฬิกาอ้างอิงอุดมคติ (ความถี่ของข้อมูลเป็นที่รู้จักกัน), DLL และ PLL อาจทำหน้าที่เดียวกัน - จัดข้อมูลที่สัมพันธ์กับนาฬิกาอ้างอิงที่มีอยู่ที่เครื่องรับ อย่างไรก็ตามวิธีการ "จัดตำแหน่ง" นั้นแตกต่างกัน PLL แตกต่างกันไปตามความถี่ในขณะที่ DLL แตกต่างกันไปตามความล่าช้า

ภาคผนวก

ป้อนคำอธิบายรูปภาพที่นี่

ป้อนคำอธิบายรูปภาพที่นี่

ที่มาของรูปภาพ: RJ Baker "การออกแบบวงจร CMOS, เค้าโครงและการจำลอง, รุ่นที่สาม"

โดยการใช้ไซต์ของเรา หมายความว่าคุณได้อ่านและทำความเข้าใจนโยบายคุกกี้และนโยบายความเป็นส่วนตัวของเราแล้ว
Licensed under cc by-sa 3.0 with attribution required.