2
เป็นไปได้ไหมที่จะสร้างตัวกรอง IIR ใน FPGA ที่มีสัญญาณนาฬิกาที่ความถี่ตัวอย่าง?
คำถามนี้เกี่ยวกับการนำตัวกรอง IIR ไปใช้ใน FPGA ด้วย DSP slices ที่มีเกณฑ์เฉพาะมาก สมมติว่าคุณกำลังสร้างตัวกรองโดยไม่มีการแตะไปข้างหน้าและแตะย้อนกลับเพียง 1 ครั้งด้วยสมการนี้: Y[ n ] = y[ n - 1 ] ⋅ b 1 + x [ n ]y[n]=y[n−1]⋅b1+x[n]y[n] = y[n-1] \cdot b1 + x[n] (ดูภาพ) ยกตัวอย่าง DSP48A1 จาก Xilinx เป็นตัวอย่าง - ชิ้นส่วน IP DSP ที่ยากที่สุดจะคล้ายกัน ให้บอกว่าคุณมีข้อมูลอะนาล็อกที่เข้ามาที่ 1 ตัวอย่างต่อนาฬิกา ฉันต้องการออกแบบตัวกรอง IIR …